SRQ Flip Flopの等価回路モデル

1. SRQ Flip Flopの等価回路モデル
Copyright (C) Marutsuelec 2016 1
1.PWM ICのデバイスモデリング
1.1 Start Up
1.2 UVLO
1.3 OVP
1.4 REFERENCE
1.5 Oscillator
1.6 RSQB Flip Flop
1.7 SRQ Flip Flop
1.8 HYSTERESIS COMPARATOR
1.9 Output Drive
1.10 Delay
1.11 2INPUT COMPARATOR
1.12 2INPUT OR GATE
1.13 3INPUT COMPARATOR
1.14 4INPUT NOR GATE
2016年4月19日
マルツエレック株式会社
http://www.marutsu.co.jp/
PWM ICのデバイスモデリング

2. 2Copyright (C) Marutsuelec 2016
ICのABMモデリング
基本構成ブロックのモデリング
フライバックコンバータのシミュレーション
フライバックコンバータのシミュレーション

3. 3
ICのデバイスモデリング
Copyright (C) Marutsuelec 2016
ICの事例(モータ・ドライバ・IC)：ブロック図+機能スペックから等価回路モデリング

4. 4
ABMのデバイスモデリング
[事例]デジタル素子
Copyright (C) Marutsuelec 2016
AND2_ABM
IN+
IN-
OUT+
OUT-
E1
IF(V(1)>1.08 & V(2)>1.08, {VOH}, {VOL})
EVALUE
R1
10
C1
10p
000
3
1
2
PARAMETERS:
VOL = 0VOH = 2.5
IN+
IN-
OUT+
OUT-
E2
IF(V(1)>1.08, {VOL}, {VOH})
EVALUE
R2
10
C2
10p
000
1 2
PARAMETERS:
VOL = 0VOH = 2.5
V1
TD = {1/FREQ}
TF = 1n
PW = {D/FREQ}
PER = {1/FREQ}
V1 = 0
TR = 1n
V2 = 1.709
0
{tdly /1k}
0
Rdly 2
1k
N3
0
Cdly 2
{tdly /1k}
N1
VOL = 0
U2
AN
N2
U5
INV_ABM
VOH = 1.709
VOL = 0
INV_ABM
端子1 端子2 端子3
H H H
L H L
H L L
L L L
端子1 端子2
H L
L H

5. 5
1.PWM ICのデバイスモデリング
4INPUT NOR GATE
RSQB Flip Flop
SRQ Flip Flop
2INPUT COMPARATOR
OVP
Oscillator
REFERENCE
Delay
UVLO
Start Up
3INPUT COMPARATOR
2INPUT OR GATE
Output Drive
HYSTERESIS COMPARATOR
Current Mode PWM Control
Low Operating Current Max: 4m[A]
UVLO:12[V]/8[V]
Soft Start Function
Over Voltage Protection 19[V]
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6. R1
10
R2
100MEG
R3
100MEG
00
SRQ_Flip_Flop_R
SRQ_Flip_Flop_S
IN+
IN-
OUT+
OUT-
E1
if ((V(SRQ_Flip_Flop_S)>4 & V(SRQ_Flip_Flop_R)<1),5,(if ((V(SRQ_Flip_Flop_S)<1 & V(SRQ_Flip_Flop_R)>4),0,V(SRQ_Flip_Flop_Q))))
EVALUE
0
C1
10p
IC = 0
1
SRQ_Flip_Flop_Q
R4
1
0
SRQ Flip Flop
V1
TD = 0
TF = 10u
PW = 10n
PER = 20.01u
V1 = 0
TR = 10u
V2 = 5
V2
TD = 10u
TF = 10u
PW = 10n
PER = 20.01u
V1 = 0
TR = 10u
V2 = 5
00
V
V
V
1.PWM ICのデバイスモデリング
1.7 SRQ Flip Flop
入力 出力
S R QB
0 0 保持
0 1 0
1 0 1
1 1 禁止
真理値表
等価回路図
6
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LTD

7. *$
* PART NUMBER: SRQ FLIP-FLOP
* COMPONENTS: SRQ FLIP-FLOP
* MANUFACTURER: Bee Technologies
* All Rights Reserved Copyright (C) Bee Technologies Inc. 2014
.SUBCKT SRQ_FLIP_FLOP SRQ_Flip_Flop_S SRQ_Flip_Flop_R
SRQ_Flip_Flop_Q
C_C1 0 N02932 10p IC=0
E_GAIN1 SRQ_FLIP_FLOP_Q 0 VALUE {1 * V(N02932)}
R_R1 N02868 N02932 10
R_R2 0 SRQ_Flip_Flop_R 100MEG
R_R3 0 SRQ_Flip_Flop_S 100MEG
E_E1 N02868 0 VALUE { if((V(SRQ_Flip_Flop_S)>4 &
+ V(SRQ_Flip_Flop_R)<1),5,(if((V(SRQ_Flip_Flop_S)<1 &
+ V(SRQ_Flip_Flop_R)>4),0,V(SRQ_Flip_Flop_Q)))) }
.ENDS SRQ_FLIP_FLOP
*$
1.PWM ICのデバイスモデリング
1.7 SRQ Flip Flop
シンボル図
ネットリスト
7
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LTD

8. 1.PWM ICのデバイスモデリング
1.7 SRQ Flip Flop
評価回路図
8
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LTD

9. Input
Output
1.PWM ICのデバイスモデリング
1.7 SRQ Flip Flop
シミュレーション結果
9
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LTD

10. 10Copyright (C) Marutsuelec 2016