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TEMA 4DISEÑO LÓGICO SECUENCIAL<br />Prof. Luis Zurita<br />
METODOLOGÍA DE EVALUACIÓN<br />Examen tipo proyecto, incluye simulación en programas como livewire o proteus (25%) más des...
METODOLOGÍA DE DISEÑO<br />PASO 1. DIAGRAMA DE ESTADOS. CASO II<br />001<br />Y=1<br />111<br />101<br />Y=0<br />011<br /...
METODOLOGÍA DE DISEÑO<br />PASO 2. TABLA DEL ESTADO SIGUIENTE<br />
METODOLOGÍA DE DISEÑO<br />PASO 3. TABLA DE TRANSICIÓN FF<br />
METODOLOGÍA DE DISEÑO<br />PASO 4. LLENADO DE LOS MK<br />¿Qué colocamos?<br />R= como conocemos las salidas, necesitamos ...
METODOLOGÍA DE DISEÑO<br />PASO 4. LLENADO DE LOS MK<br />PASO 5: ECUACIONES DE ESTADO:<br />	De los mapas de Karnaugh se ...
METODOLOGÍA DE DISEÑO<br />001<br />100<br />PASO 1. DIAGRAMA DE ESTADOS. CASO III<br />
METODOLOGÍA DE DISEÑO<br />PASO 2. TABLA DEL ESTADO SIGUIENTE<br />Nota:<br />Estados “Ruido” se reorientan a un estado vá...
METODOLOGÍA DE DISEÑO<br />PASO 1. DIAGRAMA DE ESTADOS. CASO IV<br />010<br />EDO INICIAL<br />Y=1<br />110<br />101<br />...
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Clase 5 cdii

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  1. 1. TEMA 4DISEÑO LÓGICO SECUENCIAL<br />Prof. Luis Zurita<br />
  2. 2. METODOLOGÍA DE EVALUACIÓN<br />Examen tipo proyecto, incluye simulación en programas como livewire o proteus (25%) más desarrollo del diseño (75%).<br />Según el plan de evaluación, tiene un peso porcentual del 20 %.<br />Bibliografía recomendada: Thomas Floyd, Fundamentos de Sistemas digitales y Ronald Tocci, Sistemas digitales.<br />
  3. 3. METODOLOGÍA DE DISEÑO<br />PASO 1. DIAGRAMA DE ESTADOS. CASO II<br />001<br />Y=1<br />111<br />101<br />Y=0<br />011<br />Consideración especial:<br />MSB / LSB<br />Es importante el orden.<br />
  4. 4. METODOLOGÍA DE DISEÑO<br />PASO 2. TABLA DEL ESTADO SIGUIENTE<br />
  5. 5. METODOLOGÍA DE DISEÑO<br />PASO 3. TABLA DE TRANSICIÓN FF<br />
  6. 6. METODOLOGÍA DE DISEÑO<br />PASO 4. LLENADO DE LOS MK<br />¿Qué colocamos?<br />R= como conocemos las salidas, necesitamos hallar las ecuaciones de las entradas J y K, por lo tanto se colocan las salidas con la variable de control Y.<br />J0<br />K0<br />Q1Q0<br />Q1Q0<br />00<br />00<br />01<br />01<br />11<br />11<br />10<br />10<br />YQ2<br />YQ2<br />00<br />00<br />01<br />01<br />11<br />11<br />10 <br />10 <br />
  7. 7. METODOLOGÍA DE DISEÑO<br />PASO 4. LLENADO DE LOS MK<br />PASO 5: ECUACIONES DE ESTADO:<br /> De los mapas de Karnaugh se extraen las ecuaciones simplificadas.<br />PASO 6: ELABORACIÓN DEL CIRCUITO LÓGICO EQUIVALENTE:<br /> De las ecuaciones simplificadas se procede a dibujar el circuito correspondiente.<br />
  8. 8. METODOLOGÍA DE DISEÑO<br />001<br />100<br />PASO 1. DIAGRAMA DE ESTADOS. CASO III<br />
  9. 9. METODOLOGÍA DE DISEÑO<br />PASO 2. TABLA DEL ESTADO SIGUIENTE<br />Nota:<br />Estados “Ruido” se reorientan a un estado válido<br />
  10. 10. METODOLOGÍA DE DISEÑO<br />PASO 1. DIAGRAMA DE ESTADOS. CASO IV<br />010<br />EDO INICIAL<br />Y=1<br />110<br />101<br />Y=0<br />001<br />EDO FINAL<br />
  11. 11. METODOLOGÍA DE DISEÑO<br />PASO 2. TABLA DEL ESTADO SIGUIENTE<br />Nota:<br />Estados “INICIAL” y “FINAL” se mantiene en su mismo estado dependiendo de la variable de control.<br />
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